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劉睿強 童貞理 尹洪劍編著
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本書介紹硬件描述語言VerilogHDL及電路設計方法，共11章，主要內容包括：VerilogHDL層次化設計、VerilogHDL基本語法、VerilogHDL行為描述、組合邏輯建模、行為級仿真模型建模、各層次VerilogHDL描述形式與電路建模、任務和函數、編譯預處理、VerilogHDL設計與綜合中的陷阱、異步設計與同步設計的時序分析。
劉睿強 童貞理 尹洪劍編著 ·軟件工程 ·12.6萬字
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